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自作した浮動小数点数演算アクセラレータをRISC-Vソフトコアから使う

FPGAを利用したアプリケーションでは,整数演算あるいは固定小数点数演算が一般的でした.しかし,昨今はニューラル・ネットワークのアプリケーションが増え,それに伴いFPGAでも浮動小数点数を扱う必要性が高まってきています.本稿ではRISC-Vコアのペリフェラルとして浮動小数点数演算モジュールを配置し,ソフトウェアからアクセスする方法を解説します.

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オープンソースのハードウェアTCP/IPコアを試す

完全なハードウェア・ロジックとして実装されたオープンソースのTCP/IPプロトコルスタックを使って,Alvel U250でイーサネット通信を実験します.ネットワーク機能を実際に動作させ,ネットワークのパケットを解析してみることで,性能と実装の完成度を見てみます. 簡易的なHTTPサーバを実装することで,TCP/IPスタックを使用したネットワーク機能の実現方法を解説します. We will implement the open source TCP/IP core EasyNet on the FPGA, and we will try 100Gb Ethernet communication using the Ulveo U250.

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ハードウェアトロイ

LSIの開発や製造過程において,回路に混入する危険が指摘されているハードウェアトロイを紹介します. It has been pointed out that there is a possibility that elements unintended by the designer may be mixed into the hardware design. Following the example of software Trojan horses, these Trojans are called hardware Trojans.

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RzBoard(Avnet)

動的再構成プロセッサDRP

SoCとしてRZ/V2Lを搭載するシングル・ボード・コンピュータ(SBC)RZBoardと,そのSoCに内蔵された特徴的なプロセッサDRPを紹介します. In FPGAs, the one of elements in a circuit is gate level, while DRP has a coarse-grained building block. Therefore, the amount of configuration information is small, and it is easy to perform dynamic loading (application switching). The RZ/V2L has a Cortex-A55, Cortex-M33, and DRP. DRP can be offloaded image processing from the CPU.

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EFINIX FPGA

[特別版 No.1 掲載] 本稿ではエフィニックスの統合開発環境EfinityのインストールからLチカまでを試します. エフィニックスの新しいシリーズTitaniumを搭載した開発ボードTi180 M484を使います.

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